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適用于現(xiàn)場可編程門陣列I/O通道的可編程延時單元結(jié)構(gòu)設(shè)計方法研究
高麗江; 楊海鋼; 韋援豐; 李威 中國科學(xué)院電子學(xué)研究所; 北京100190; 中國科學(xué)院大學(xué); 北京100049; 中國科學(xué)院計算技術(shù)研究所; 北京100190
- 現(xiàn)場可編程門陣列
- 細調(diào)延時單元
- 粗調(diào)延時單元
- 輸入輸出通道
摘要：本文對FPGA芯片輸入輸出通道模塊的可編程延時單元設(shè)計方法進行了研究,針對可編程延時單元所需的延時調(diào)整范圍廣、延時調(diào)整精度高、延時級數(shù)多的特性,提出了一種輸入輸出信號時序可調(diào)整的結(jié)構(gòu)設(shè)計方法,以滿足總線信號邊沿對齊或電路建立與保持時間的要求.所設(shè)計的延時鏈采用粗調(diào)延時單元與細調(diào)延時單元相結(jié)合的方式提高精度和覆蓋范圍,并在較少的控制向量下,實現(xiàn)了45級延時.延時鏈延時步進精度為100ps,延時最大值為4.58ns.其功耗和面積分別是傳統(tǒng)反相器鏈結(jié)構(gòu)延時單元的34.5%和55.9%.
- 現(xiàn)場可編程門陣列
- 細調(diào)延時單元
- 粗調(diào)延時單元
- 輸入輸出通道
摘要：本文對FPGA芯片輸入輸出通道模塊的可編程延時單元設(shè)計方法進行了研究,針對可編程延時單元所需的延時調(diào)整范圍廣、延時調(diào)整精度高、延時級數(shù)多的特性,提出了一種輸入輸出信號時序可調(diào)整的結(jié)構(gòu)設(shè)計方法,以滿足總線信號邊沿對齊或電路建立與保持時間的要求.所設(shè)計的延時鏈采用粗調(diào)延時單元與細調(diào)延時單元相結(jié)合的方式提高精度和覆蓋范圍,并在較少的控制向量下,實現(xiàn)了45級延時.延時鏈延時步進精度為100ps,延時最大值為4.58ns.其功耗和面積分別是傳統(tǒng)反相器鏈結(jié)構(gòu)延時單元的34.5%和55.9%.
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微電子學(xué)與計算機
- 預(yù)計1-3個月 預(yù)計審稿周期
- 0.71 影響因子
- 計算機 快捷分類
- 月刊 出版周期
主管單位：中國航天科技集團有限公司;主辦單位：西安微電子技術(shù)研究所
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