首頁 > 期刊 > 自然科學(xué)與工程技術(shù) > 基礎(chǔ)科學(xué) > 自然科學(xué)理論與方法 > 科技與創(chuàng)新 > 極化碼交織模式動態(tài)生成電路設(shè)計與實現(xiàn) 【正文】
摘要:針對3GPP交織模式定義和子交織模式的實現(xiàn)算法,提出動態(tài)交織的概念。利用Verilog語言,以FPGA為基礎(chǔ),利用ROM模塊設(shè)計交織模式和解交織模式存儲器,通過程序動態(tài)寫入交織和解交織模式數(shù)據(jù)。利用RAM模塊設(shè)計存儲編碼信息的數(shù)據(jù)存儲器,根據(jù)動態(tài)交織算法設(shè)計交織模式動態(tài)生成電路,經(jīng)仿真測試電路工作理想,可以控制信道短碼傳輸中的動態(tài)交織過程。
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